[當VHDL和verilog混用時]
Bootstrap Dynamic Linking :
setenv LD_LIBRARY_PATH <Novas_install>/share/PLI/ldv4.0_vhpi/SOLARIS2/boot
%ncelab -f run.f -access+r -loadfmi debfmi:debfmi_boot ---------> If Top Level is VHDL
%ncelab -f run.f +debug -loadpli1 debpli:debpli_boot ---------> If Top Level is Verilog
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熱臉貼冷屁股的感覺很不好，
狡兔死走狗烹的感覺更差，
偏偏又來個颱風搗蛋，
一早上班車就壞了，
罵上破財，
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第一次在電影院，
等著電影的黑幕靜靜到結束還不起身，
是九降風給我最直接的感受和衝擊。
在青春裡掙扎，
有過，
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兩星期之後，
少一根筋的我，不小心又少帶了一本課本，
剛好又是鹹酸甜的課，
沒錯，歷史再度重演，
看來我和這歷史這科註定結下不解之緣，
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看到Laurence Sterne在1760年出版的Tristram Shandy一書中所提到的，
「寫作，如果處理得宜，應該是另一種形式的對話...」
給了我一個解釋，
關於遠離那個愛寫東西自已經很遙遠的我，
為什麼又會有動筆的衝動，
對於每一個閱讀我文字的朋友，
我期待和大家分享彼此的心情和想法，
不管是一起經歷過這些故事點滴的朋友們，重溫後的另有所感；
還是只是路過此處的朋友們，引起你們內心裡類似的記憶的共鳴，
對我來說，我喜歡這樣無聲的話語，
因為只要一點點，
就很夠味。
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「張志傑，書都沒帶上什麼課?去後面罰站。」
厚，書那麼多， 少一本難免嘛!!
每天要我們帶那麼多書，當初入學考試又沒考體能，看來以後一定是長不高了，
我一個人暗自嘀咕著，
結果坐旁邊的水坤兄聽到了，
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『同學!! 剛剛講的了不了解?
已經上課一星期了如果聽不懂的千萬別把問題積著，要趕快問老師，知道嗎?』
說話的是理化老師纖纖，是今年剛進來的新老師。
在這間學校第一年服務的新老師通常是最受愛戴的，
尤其是女老師，為什麼呢?
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「不可能，這一定是作夢，而且還是一個很糟的惡夢 」教室的一角有人驚呼著。
第二天的早晨七點半，
『各位同學把書收起來，抽考作業裡的課文默書!』
昨天脫序的歡樂並沒有持續多久，
悲情的開學默書抽考，
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「歡迎光臨!」
『哈囉! 真巧~酒窩小姐，今天又輪到你職班阿~』
「對阿，因為平常要上課所以我才都排假日班，你勒?」
『看來我們出沒的時間很像嘛，我是因為平常要上班所以也才都這時間出現。』
「原來是這樣，今天要點什麼呢?」
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嗶‧‧‧。
一名員工一早進辦公室聽到的聲音，
沒開燈的辦公室，傳出電腦裡蜂鳴器特有的嗶聲，
拖曳的長音在安靜的凌晨顯得有些刺耳，
尋著聲音他走到了前輩的桌前，
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當一個空間充滿太多新鮮因子時，
對活力充沛的國二生來說，
顯然陌生所造成的隔閡與安靜無法持續太久，
所以不一會功夫，
整個教室馬上變得鬧哄哄了，
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「喂~你是那一班的阿，我是以前七班。」
說話的是大軍，坐在我正後方六點鐘的坐位，
他是分班後第一個跟我說話的人，
第一眼看到他我一度懷疑他是滿清餘孽，
完美的頭形跟以前滿清的王公貴族沒啥兩樣，
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